Download miễn phí Đồ án Điều khiển và nhận dạng tiếng nói bằng xử lý tín hiệu số DSP56000
GIỚI THIỆU BỘ XỬ LÍ TÍN HIỆU SỐ &KHỐI ĐÁNH GIÁ DSP56002
Trong chương này, sẽ giới thiệu tổng quát về bộ xử lý tín hiệu số DSP56002 và các chân của nó.
A. MÔ TẢ TỔNG QUÁT BỘ XỬ LÍ TÍN HIỆU SỐ DSP56002:
DSP56002 là bộ xử lí tín hiệu đơn chip, đa dụng. Khối đánh giá DSP56002EVM có giá thành thấp, sử dụng bộ xử lí DSP56002 cho việc thiết kế hệ thống xử lí tín hiệu số thời gian thực.
Họ xử lí DSP56000 được tạo thành từ một bộ chip vi xử lí tín hiệu số 24-bit, hiệu suất cao và một vùng mở rộng. Trong vùng mở rộng, chip có thể trợ giúp cấu hình cho các thiết bị bộ nhớ và ngoại vi thay đổi tùy theo loại trong họ.
DSP56002 là một loại trong họ xử lí DSP56000 bao gồm bộ phận chính xử lí tín hiệu số tương thích vơí họ 56000, được nạp bằng RAM chương trình trên chip, có 2 RAM dữ liệu độc lập, 2 ROM dữ liệu với các bảng sine, -law va A-law. DSP56002 chứa bộ giao tiếp truyền thông nối tiếp, giao tiếp chủ song song, bộ đếm thời gian/sự kiện, bộ vòng khóa pha, một cổng mô phỏng trên chip.
Bộ xử lí DSP56002 cung cấp các đặc trưng phong phú trong việc xử lí tín hiệu số.
DSP56002 Technical Literature
I.KHỐI TRUNG TÂM XỬ LÍ TÍN HIỆU SỐ
1.Những bộ phận chính:
1.1.Ba đơn vị thực thi độc lập:
• Đơn vị dữ liệu số học logic
• Đơn vị cấp phát địa chỉ(AGU)
• Đơn vị điều khiển chương trình
1.2.Bốn bus dữ liệu 24 bit độc lập:
• Bus dữ liệu X (XDB)
• Bus dữ liệu Y (YDP)
• Bus dữ liệu chương trình (PDB)
• Bus dữ liệu toàn cục (GDB)
1.3.Ba bus địa chỉ 16 bit độc lập:
• Bus địa chỉ X (XAB)
• Bus địa chỉ Y (YAB)
• Bus địa chỉ chương trình (PAB)
1.4.Cổng mở rộng bộ nhớ (Port A)
1.5.Mạch mô phỏng trên chip (OnCE)
1.6.Vòng khóa pha (PLL)
2.Đặc điểm chính của DSP56002:
40 triệu lệnh/giây (MIPS) tại tần số 80Mhz
240 triệu phép xử lí /giây (MOPS) tại tần số 80Mhz
Thực hiện lệnh song song với chế độ định địa chỉ
Nhân tích lũy song song 24x24 bit trong 1 chu kỳ lệnh (2 chu kỳ xung clock)
Đặt zero ở mỗi đầu dòng lặp DO
Các ngắt tự động trở về rất nhanh
Thiết kế CMOS tiêu thụ công suất thấp
Chế độ treo(standby) tiêu thụ công suất thấp cho STOP và WAIT
http://s1.liketly.com/flash/edoc/jh2i1fkjb33wa7b577g9lou48iyvfkz6-swf-2013-02-20-do_an_dieu_khien_va_nhan_dang_tieng_noi_bang_xu_ly.BlcOZIUL0z.swf /tai-lieu/de-tai-ung-dung-tren-liketly-3316/Để tải bản Đầy Đủ của tài liệu, xin Trả lời bài viết này, Mods sẽ gửi Link download cho bạn sớm nhất qua hòm tin nhắn.Ai cần download tài liệu gì mà không tìm thấy ở đây, thì đăng yêu cầu down tại đây nhé:
Nhận download tài liệu miễn phí
Tóm tắt nội dung tài liệu:
GIỚI THIỆU BỘ XỬ LÍ TÍN HIỆU SỐ &KHỐI ĐÁNH GIÁ DSP56002
Trong chương này, sẽ giới thiệu tổng quát về bộ xử lý tín hiệu số DSP56002 và các chân của nó.
A. MÔ TẢ TỔNG QUÁT BỘ XỬ LÍ TÍN HIỆU SỐ DSP56002:
DSP56002 là bộ xử lí tín hiệu đơn chip, đa dụng. Khối đánh giá DSP56002EVM có giá thành thấp, sử dụng bộ xử lí DSP56002 cho việc thiết kế hệ thống xử lí tín hiệu số thời gian thực.
Họ xử lí DSP56000 được tạo thành từ một bộ chip vi xử lí tín hiệu số 24-bit, hiệu suất cao và một vùng mở rộng. Trong vùng mở rộng, chip có thể trợ giúp cấu hình cho các thiết bị bộ nhớ và ngoại vi thay đổi tùy theo loại trong họ.
DSP56002 là một loại trong họ xử lí DSP56000 bao gồm bộ phận chính xử lí tín hiệu số tương thích vơí họ 56000, được nạp bằng RAM chương trình trên chip, có 2 RAM dữ liệu độc lập, 2 ROM dữ liệu với các bảng sine, m-law va A-law. DSP56002 chứa bộ giao tiếp truyền thông nối tiếp, giao tiếp chủ song song, bộ đếm thời gian/sự kiện, bộ vòng khóa pha, một cổng mô phỏng trên chip.
Bộ xử lí DSP56002 cung cấp các đặc trưng phong phú trong việc xử lí tín hiệu số.
DSP56002
24 bit
DSP56000
Family manual
#DSP56KFAMUM/AD
DSP56002
Technical data
#DSP56002/D
DSP56002
User’s Manual
#DSP56002UM/AD
DSP56002 Technical Literature
I.KHỐI TRUNG TÂM XỬ LÍ TÍN HIỆU SỐ
1.Những bộ phận chính:
1.1.Ba đơn vị thực thi độc lập:
Đơn vị dữ liệu số học logic
Đơn vị cấp phát địa chỉ(AGU)
Đơn vị điều khiển chương trình
1.2.Bốn bus dữ liệu 24 bit độc lập:
Bus dữ liệu X (XDB)
Bus dữ liệu Y (YDP)
Bus dữ liệu chương trình (PDB)
Bus dữ liệu toàn cục (GDB)
1.3.Ba bus địa chỉ 16 bit độc lập:
Bus địa chỉ X (XAB)
Bus địa chỉ Y (YAB)
Bus địa chỉ chương trình (PAB)
1.4.Cổng mở rộng bộ nhớ (Port A)
1.5.Mạch mô phỏng trên chip (OnCE)
1.6.Vòng khóa pha (PLL)
2.Đặc điểm chính của DSP56002:
40 triệu lệnh/giây (MIPS) tại tần số 80Mhz
240 triệu phép xử lí /giây (MOPS) tại tần số 80Mhz
Thực hiện lệnh song song với chế độ định địa chỉ
Nhân tích lũy song song 24x24 bit trong 1 chu kỳ lệnh (2 chu kỳ xung clock)
Đặt zero ở mỗi đầu dòng lặp DO
Các ngắt tự động trở về rất nhanh
Thiết kế CMOS tiêu thụ công suất thấp
Chế độ treo(standby) tiêu thụ công suất thấp cho STOP và WAIT
II.VÙNG MỞ RỘNG
Những bộ phận chính trong vùng mở rộng:
Ram chương trình 512x24
2 Ram dữ liệu 256x24
2 Rom dữ liệu 256x24
Giao tiếp chủ độ rộng byte bằng phương pháp DMA
Cổng giao tiếp nối tiếp đồng bộ (SSI)
Cổng giao tiếp nối tiếp bất đồng bộ(SCI)
B.GIỚI THIỆU DSP56002EVM
DSP56002EVM là công cụ phần cứng dành cho việc thiết kế, sữa lỗi và đánh giá hệ thống căn bản của DSP56002. Bao gồm ba bộ phận quan trọng:
Mạch đánh giá DSP56002 chứa bộ xử lí DSP56002, bộ nhớ mở rộng off-chip, bộ biến đổi stereo A/D và D/A, mạch giao tiếp và điều khiển, và nhiều đường nối dành cho truy xuất ngoài.
Trình biên dịch Motorola.
Cửa sổ giao diện của phần mềm debug EVM.
Phần mềm chạy trong MS-DOS và nối liền với EVM qua port nối tiếp RS-232. Người sử dụng phải cung cấp nguồn 7®9V AC và DC, 700mA và cáp RS-232 với 9 bus dữ liệu.
RS-232
MC68705
MCU
FLASH
EEPROM
32Kx24
SDRAM
DSP56002
STEREO
A/D-D/A
A/D –D/A
SSI
SCI
RS-232
OnCEPORT
MÁY TÍNH
C.GIỚI THIỆU TỔNG QUÁT CÁC CHÂN:
1.Các tín hiệu cổng A:
Các tín hiệu cổng A được chia thành ba nhóm chức năng:
Bus địa chỉ (A0-A15)
Bus dữ liệu (D0-D23)
Bus điều khiển. Các tín hiệu điều khiển có thể chia thành 3 nhóm nhỏ:
Điều khiển ghi đọc (RD~/WR~).
Lựa chọn không gian địa chỉ (bao gồm chọn bộ nhớ chương trình PS~, chọn bộ nhớ dữ liệu DS~, chọn X/Y~).
Điều khiển truy xuất (BN~, BR~, BG~,WT~, BS~).
2.Điều khiển chế độ ngắt:
2.1 . Chế độ A / Yêu cầu ngắt ngoài A / Lấy lại STOP:
Đầu vào này có ba chức năng. Nó làm việc với các chân MODB và MODC để chọn chế độ hoạt động của chip, nó nhận một yêu cầu ngắt từ bên ngoài, nó bật bộ phát xung nhip bên trong, khiến chip khôi phục từ trạng thái xử lí dừng.
2.2 . Chọn chế độ B / Yêu cầu ngắt ngoài B:
Chân vào này làm việc với các chân MODA và MODC để chọn chế độ hoạt động của chip, nó nhận một yêu cầu ngắt từ bên ngoài.
2.3 . Chọn chế độ C / Yêu cầu ngắt không che:
Chân này làm việc với các chân MODA và MODB để chọn chế độ hoạt động của chip, nó thu một yêu cầu ngắt từ bên ngoài.
2.4 . Reset (RESET):
Chân vào Schmitt trigger được dùng để reset DSP56002. Khi reset được tác động DSP được khởi động và đặt trong trạng thái reset. Khi chân reset không được tác động chip ghi trạng thái các chân chế độ (MODA, MODB, MODC ) vào thanh ghi chế độ hoạt động của chip.
3.Năng lượng và xung nhịp:
3.1 . Nguồn điện (VCC) , đất (GND):
Có 6 cặp chân nguồn và đất dùng cho các chức năng: logic nội, bộ đệm ngỏ ra bus địa chỉ, dữ liệu, cổng B và C, Once, PLL, chân CKOUT.
3.2 . Xung nhịp ngoài / Đầu vào tinh thể (EXTAL):
Đầu vào EXTAL giao tiếp bộ dao động tinh thể bên ngoài hay bên trong.
3.3 . Đầu ra tinh thể (XTAL):
Đầu ra này nối với chân ra của bộ dao động tinh thể bên trong với một tinh thể bên ngoài.
4.Giao tiếp chủ:
4.1 . Bus dữ liệu chủ (H0-H7):
Bus dữ liệu hai hướng này truyền dữ liệu giữa bộ giao tiếp chủ và DSP56002. Nó hoạt động như một ngỏ vào trừ khi chân được tác động tích cực và HR/ ở mức cao khiến cho H0-H7 trở thành ngỏ ra và cho phép bộ giao tiếp chủ đọc dữ liệu DSP56002.
4.2 . Địa chỉ chủ(HA0-HA2):
Các đầu vào này cung sự lựa chọn cho mỗi thanh ghi giao tiếp chủ.
4.3 . Đọc / Viết chủ:
Đầu vào này chọn hướng truyền dữ liệu đối với mỗi truy xuất bộ xử lí chủ. Nếu HR/ là cao và được tích cực, H0-H7 là các đầu ra. Nếu HR/ là thấp và được công bố, H0-H7 là các đầu vào.
4.4 . Chủ yêu cầu (HREQ):
Tín hiệu ra cực máng hở này được sử dụng bởi giao tiếp chủ để yêu cầu phục vụ từ bộ xử lí chủ, bộ điều khiển DMA, hay một bộ điều khiển bên ngoài đơn giản.
4.5 . Chủ chấp nhận (HACK):
Đầu vào này có hai chức năng . Nó cung cấp một tín hiệu bắt tay chủ chấp nhận cho việc truyền DMA và có thu một ngắt chủ chấp nhận tương thích với bộ xử lí họ MC68000
5.Giao tiếp truyền thông nối tiếp (SCI):
5.1 . Dữ liệu thu(RXD):
Đầu vào này thu dữ liệu hướng byte và truyền dữ liệu đó đến thanh ghi dịch thu SCI.
5.2 . Dữ liệu phát(TXD):
Đầu ra này phát dữ liệu nối tiếp từ thanh ghi dịch phát SCI.
5.3 . Xung nhịp nối tiếp (SCLK):
Chân hai hướng này cung cấp xung nhịp vào hay ra từ nơi mà tốc độ baud phát và/hay thu được lấy ra trong chế độ bất đồng bộ, và từ nơi mà dữ liệu được truyền trong chế động bộ.
6.Giao tiếp nối tiếp đồng bộ(SSI):
6.1 . Xung nhịp nối tiếp 0 (SC0):
Chức năng chân hai hướng này được xác định bởi việc SCLK ở chế độ đồng bộ. Ở chế độ đồng bộ, chân này được sử dụng cho cờ nối tiếp nhận. Trong chế độ bất đồng bộ, chân này thu xung nhịp xuất nhập .
6.2 . Điều khiển nối tiếp 1 (SC1):
SSI sử dụng chân hai hướng này để điều khiển cờ hay sự đồng bộ khung.
6.3 . Điều khiển nối tiếp 2 (SC2):
SSI sử dụng chân hai hướng này để điều khiển sự đồng bộ khung.
6.4 . Xung nhịp n...
